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如何处理数字逻辑模拟器中的循环?

我正在开发一个数字逻辑模拟器,以便稍后在其中构建我自己的CPU(因此这是一个长期项目).一切都适用于没有环路的电路,例如fulladder.然后有像SR锁存器那样的电路,其中一个门的输入连接到另一个门的输出.所以我处于循环中,因为两个门都需要另一个门的输出,以计算自己的输出.
解决这个问题的最佳方法是什么?我以某种方式实现它(当检测到循环时)它将返回它的最后一个输出.或者,当此运行是第一个(因此没有先前的输出)时,我将返回零(低).所以我假设所有输出在开始时都是低/零.它到目前为止有效,但我确信这不是解决问题的好方法.

有任何想法吗?

loops circuit digital-logic

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