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分配和锁存器不完整

当不完全分配一个值时,我得到一个闩锁。但是为什么在下面的示例中会出现闩锁?我认为不需要F输出锁存器,因为它定义为的所有值SEL

Verilog代码:

always @ (ENB or D or A or B pr SEL)
    if (ENB)
    begin 
        Q=D;
        if (SEL)
            F=A;
        else
            F=B;
    end
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推断逻辑:

https://imgur.com/kLW4QGe

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