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VHDL:正在使用inout端口的不良做法?

我有一个程序,我正在使用inout端口:

port : inout unsigned(9 downto 0);
...
if port > 10 then
   port <= port + 1
end if;
Run Code Online (Sandbox Code Playgroud)

我正在使用inout端口,所以我可以读取输出(以实现反馈).

要么我和老师之间存在误解,要么我的老师强烈反对使用inout端口.

我已经习惯了高级编程,所以写这样的代码对我来说并不奇怪.我知道在FPGA上没有太多具有inout端口的电路,但是我并没有经常使用它,而且只是为了获得我想要的功能而将端口分成输入和输出是我的意思.不同的方式.

关于使用inout端口的第二意见,我将很高兴.

port vhdl

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用于Java的OpenGL数学(GLM)端口

是否有GLM库的 Java端口?我正在使用LWJGL而我错过了一些很好的GLM功能.

我在这个答案中看到了关于端口的提及,但我不知道如何联系写答案的人(stackoverflow上没有消息,没有可能在已关闭的问题上添加评论).

java opengl lwjgl glm-math

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