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在 verilog 中，我有一个二进制值数组。如何取减去值的绝对值？

Verilog 代码：

module aaa(clk);
  input clk;

  reg [7:0] a [1:9];  
  reg [7:0] s [1:9];

  always@(posedge clk)  
  begin
    s[1] = a[1] - a[2];
    s[2] = a[2] - a[3];
    s[3] = a[1] + a[3];
  end
endmodule

我想我s[1]和s[2]值总是正的。我怎样才能在可综合的 verilog 中做到这一点？

我试过使用signed reg，但它显示一个错误。

我有一个3*3矩阵 A

A = [1 2 3               
     4 5 6 
     7 8 9];

我想只复制这个矩阵的第一行和第一列.应该是这样的

  1 1 2 3

  1 1 2 3

  4 4 5 6

  7 7 8 9

谁能告诉我怎样才能在matlab中做到这一点